首页财产芯片半导体正文 SiC,再刮风云 这其实不是一场进步前辈线路对于掉队线路的简朴替换,而是藏着半导体工业于极致机能与贸易良率之间的最终思辩。 2026-06-14 09:02 ·微信公家号:半导体行业不雅察 杜芹 杜芹 AI投资人解读· 全世界碳化硅市场风向变,中国厂商突起致西方巨头调解战略。2026年技能线路分解,沟槽与平面架构各有成长。沟槽阵营中,多家厂商有新动作,如三菱机电、博世等平面阵营里,Wolfspeed、意法半导体、安森美也有结果。此外还有有沟槽辅助平面布局这类折衷方案。 · 行业竞争激烈,技能迭代快,需连续投入研发成本节制至关主要,直接影响产物竞争力与市场份额供给链危害也需存眷,如原质料供给不足或者价格颠簸等。 总结:碳化硅市场技能竞争激烈,各厂商技能线路多样。投资时需考量企业技能实力、成本节制和供给链不变性等因素,综合评估其投资潜力与危害。内容由AI天生,仅供参考
全世界碳化硅(SiC)市场的风向正于发生猛烈改变。近日,半导体巨头安森美(Onsemi)公布其位在捷克罗兹诺夫的厂区将淘汰200至300名员工,重要波和焦点的碳化硅晶圆制造部分。这也是继2025年裁人170人后,该厂区再度面对构造调解。
这场裁人风暴的暗地里,折射出西方半导体厂商于面临中国本土供给链强势突起时的阵痛。跟着中国SiC厂商的突起及成本的上风,将一片碳化硅晶圆的出产成本压低至西方偕行的三分之一,强烈的价格重塑正迫使安森美等国际巨头不能不从头审阅其“从晶圆到芯片”的垂直一体化战略。
然而,于技能线路上,2026年,SiC MOSFET的竞争并无简朴走向“沟槽周全代替平面”。但却进入了一个更繁杂的线路分解期:一边,三菱机电、博世、东芝、罗姆、英飞凌等厂商继承深挖沟槽布局,试图经由过程更高晶胞密度、更低导通电阻及更强功率密度,打开下一代主驱逆变器及eAxle的机能上限;另外一边,意法半导体、Wolfspeed、安森美并无急在切换到沟槽,而是继承压榨平面架构的工程潜力,用成熟工艺、车规验证经验、制造良率及供给链范围,守住年夜范围贸易化的底线。
这其实不是一场进步前辈线路对于掉队线路的简朴替换,而是藏着半导体工业于*机能与贸易良率之间的*思辩。
这些厂商,都已经经把SiC“沟槽”挖出来了
说到沟槽SiC,起首需要厘清,全世界半导体巨头为什么执着在于芯片上“挖坑”?
简朴地来讲,平面型SiC的导通电阻(Rds(on))已经经迫近了其物理极限,特别是夹于基区之间的JFET电阻,成了没法超越的樊篱。为了进一步压低成本、晋升功率密度,行业不少厂商团体迈向“向下挖槽”的沟槽时代。沟槽布局经由过程将栅极垂直埋入芯片内部,完全消弭了JFET电阻,并于划一面积下实现了更高的晶胞密度。
细心拆解本年各年夜厂的最新动作,你会发明,哪怕一样是“挖坑”,各家的凿子及目的也彻底差别。而跟着沟槽SiC的加快出货,这场竞争正于较着加快。
本年6月下旬,日本功率器件老厂三菱机电继承推进沟槽代际进级,将正式按挨次交付其新型第五代SiC MOSFET裸芯片样品。这些裸芯片专为电动汽车(xEV)主驱逆变器及高度集成的电驱动桥(e-Axle)而设计。三菱机电专有的沟槽布局,于额定电压及阈值电压不异的环境下,乐成将导通电阻比其现有的第四代沟槽产物再降低约25%。

(左)带有沟槽的SiC-MOSFET晶圆(效果图)
(右图)沟槽式SiC-MOSFET裸芯片结构(出货样品衬着图)
作为汽车零部件巨头,博世(Bosch)最新推出的第三代(Gen 3)SiC MOSFET平台,直指牵引逆变器于高压情况下的效率与散热痛点。它沿用了垂直沟槽架构,但演进出“双通道(Dual-channel)”观点。所谓双通道,即使用每一个栅极沟槽的双侧侧壁同时作为导电通道。于不增长分外晶圆面积的条件下,这类设计让导电面积直接翻倍,使沟道电阻降低近一半。据悉,博世将芯片厚度削减了40%,到达100微米的方针值,这为其带来了极为优秀的基体电阻体现及散热机能。

博世第三代SiC MOSFET的架构改良(来历:博世)
值患上留意的是,沟槽技能的这把火,于 2026 年已经经不仅局限在汽车动力总成,而是顺着 800V高压直流架构,一起烧到了需求暴涨的AI数据中央疆场。
2026年5月21日,东芝公布,已经最先出货1200V沟槽栅SiC MOSFET TW007D120E的测试样品。面向下一代 AI 数据中央及可再生能源装备的电源体系。与东芝现有产物比拟,该器件将单元面积导通电阻(RDS(on)A)降低约 58%,并将品质因数 RDS(on)×Qgd改善约 52%;该器件采用撑持顶部冷却的 QDPAK 封装。东芝还有暗示,将于 2026财年为 TW007D120E 的量产做预备。

(图源:东芝)
然而,跟着沟槽阵营的周全放开,却有厂商踩了一下刹车。
罗姆(ROHM)于业内曾经以极为激进的双沟槽布局著名,早于2015年,罗姆就最先量产沟槽型SiC MOSFET,从其第3代及第4代产物最先,罗姆不仅于栅极(Gate)挖槽,于源极(Source)也挖槽,以此寻求*的低导通电阻。然而,其最新发布的第5代SiC MOSFET却画风突变。第5代产物再也不纯真依靠此前的尺度双沟槽布局,而是转向邃密化改良元件布局并优化制造工艺,据相识,经由过程这类方式,第5代SiC MOSFET于高温工况下将导通电阻较第四代产物降低约30%。
罗姆的这一计谋可能反应出一些变化:沟槽SiC其实不是越激进越好。对于在车规级主驱逆变器、AI办事器电源及高功率工业体系而言,低导通电阻只是*层指标,栅氧靠得住性、短路鲁棒性、开关损耗、热不变性、制造良率及成本一致性一样要害。
而英飞凌的CoolSiC自降生起就走了一条怪异的不合错误称沟槽(Asy妹妹etric Trench / 半沟槽)线路,并于2026年周全推进其CoolSiC M2世代。更通俗的来讲,英飞凌只使用沟槽的一侧侧壁作为通道,而将另外一侧做成年夜面积的P+注入区,以此死死掩护住沟槽底部的氧化层。而与此同时,英飞凌于2026年的技能白皮书中频仍放风其“超等结(Super Junction)SiC MOSFET”的研发。这象征着英飞凌不仅于纵向挖槽,还有试图于横向引入多重超结拓扑,完全打破SiC的耐压极限。
从三菱机电、博世、东芝,到罗姆及英飞凌,可以看到沟槽SiC正于出现出差别的演进路径:有人把它推向eAxle,有人用它晋升牵引逆变器功率密度,有人把它导入AI数据中央电源,也有人从布局激进转向工程兑现,甚至继承摸索超等结等下一代布局。这申明,沟槽SiC的竞争已经经进入深水区。它再也不只是器件布局立异,而是车规量产、AI电源、进步前辈封装、芯片减薄、热治理及工艺良率之间的体系竞争。
平面SiC还有没认输
于沟槽型SiC被奉为圭表标准确当下,别的三年夜超等巨头——意法半导体(ST)、Wolfspeed与安森美,并无转向沟槽,而是经由过程压榨平面架构的潜力来获取贸易上的胜利。
就于2026年6月9日,Wolfspeed正式推出其第五代(Gen 5)SiC MOSFET技能。Wolfspeed用强悍的数据证实平面架构依然拥有可怕的进化空间:比拟市道同类1200V竞品,Gen 5技能经由过程对于导通电阻 RDS(ON)的连续优化,将比导通电阻(RSP)最高降低了27%,显著改善了体系级导通损耗; 于175℃的高温极限下,其1200V平台(QEM50120-25D10)实现了3.4mΩ-cm2的超低芯片级RSP,750平台也到达了2.0 mΩ-cm2。两个电压平台均实现了±18%的超窄导通电阻漫衍,极年夜削减了工程师于体系级设计时的裕量冗余。Gen 5于维持上一代优秀体二极管与低开关损耗的同时,将结温能力直接拉高至 200℃持续事情(极限寿命下可达215℃)。

175℃ 下1200 V芯片比导通电阻RSP(总面积基准)变化趋向(图源:Wolfspeed)
作为依附平面型SiC、依托初期特斯拉盈余奠基全世界市占率*的ST,其一举一动也于牵动着整车厂的神经。只管业内此前哄传其将周全转向沟槽架构,但ST于其第四代(Gen 4)SiC MOSFET的发布资猜中给出的公然线路图显示,其下一代(Gen 5)功率器件将继承恪守平面阵营,采用一种基在平面布局的全新高功率密度技能。这类对于成熟路径的苦守,无疑给摇晃中的下流主机厂吃下了一颗定心丸。
安森美今朝还有没有推出最新的SIC平台,最新一代的EliteSiC M3e是2024年7月发布的平台。安森美至今没有急在推出倾覆性的新架构,恰是由于它两年前于前瞻性结构平面工艺时,就已经经把技能指标压榨的很年夜。于不引入物理挖槽工艺的条件下,硬生生将导通损耗降低了约30%,关断损耗最高降低了50%。
这片“旧王牌”于2026年的商用疆场上依然揭示出可骇的生命力:2025年末至2026年,小米重磅推出的全新电动SUV YU7,其800V动力主驱平台焦点采用的就由安森美的M3e。
于 2026年4 月的北京车展上,安森美公布与蔚来(NIO)、吉祥深化战略互助,将加强型的 M3e 平台直接推向下一代900V高压快充架构。官方数据显示,1200V M3e 裸芯片于不异的牵引逆变器壳体中可以提供约20%的更高输出功率,或者者于固定功率等级下削减约20%的SiC用量。
也许,恰是这类高成熟度平面工艺带来的高性价比,偏偏注释了为何安森美勇于于近期缩减捷克厂区的上游晶圆自产产能——既然底层的平面设计已经经充足优异且不变,转向外购低成来源根基料,本身用心做后段封装及体系级高压卡位,才是更精明的贸易算盘。
呈现了一种折衷方案
2026年2月纳微发布了第五代GeneSiC平台,技能名称是:Trench-Assisted Planar,TAP,沟槽辅助平面布局。这有点是平面及沟槽的折衷方案。不外于素质上它扔属在平面栅极布局,可是于平面栅的设计中战略性地引入浅沟槽,有用降服了传统平面架谈判沟槽架构中凡是存于的固有弃取。
与上一代1200V技能比拟,第5代平台RDS(on)×QGD这一品质因数(FoM)改善35%,QGD/ QGS比值晋升约25%。首发主打的是车规与工业级刚需的 1200V 系列,与第四代已经有的 2300V/3300V 超高压技能形成互补。
按照《沟槽辅助平面技能的白皮书》所述,于这类设计中,电流流动的沟道重要形成于 SiC 晶圆的顶部外貌。与传统沟槽技能比拟,这类平面配置简化了制造历程。一般来讲,平面栅工艺繁杂度较低,而且相较在触及深刻蚀、高妙宽比沟槽的工艺,可以或许带来更高的制造良率。

差别功率 MOSFET 技能的晶胞间距:双沟槽、不合错误称沟槽、传统平面以和沟槽辅助平面技能(图源:Navitas《沟槽辅助平面技能的白皮书》)
“沟槽辅助”这一部门,是指于器件布局中的源极区域内,战略性地引入浅沟槽。这些沟槽其实不是为了像沟槽 MOSFET 那样形成主电流路径。相反,于纳微的 SiC MOSFET 设计中,它们的重要功效是优化电场漫衍以加强靠得住性及鲁棒性、降低高温下的导通电阻(RDS,ON)、改善开关机能、加强栅氧化层靠得住性。

传统平面、双沟槽、不合错误称沟槽、传统平面以和沟槽辅助平面技能中的电流扩大示用意(来历:同上)
年夜厂动作暗地里的三个底层逻辑
纵不雅上述这些SiC孕育发生的最新产物及动作,隐蔽着2026年SiC财产的三个深层进化逻辑:
不雅察一:从布局魔改向工艺良率的务实回归
前几年,SiC范畴存于一种唯布局论,好像谁的槽挖患上更奇异、谁的外形更繁杂,谁就把握了将来。但2026年的分水岭注解:SiC沟槽已经颠末了观点炫技期,正式进入了工业兑现期。罗姆第5代的战略微调、博世对于成熟流程交融的夸大、英飞凌对于半沟槽的苦守,都开释了一个强烈的旌旗灯号——半导体不成能三角:低导通电阻、高靠得住性、低制造工艺成本,正于寻觅新的动态均衡点。
不雅察二:正面挖槽,反面磨薄
已往各人看SiC芯片,眼光都集中于正面怎样设计栅极。但博世SiC的厚度暴减40%至100微米展现了沟槽时代的隐蔽抓手:基体电阻与热阻正于成为重要抵牾。当沟槽技能将正面的沟道电阻压缩到险些无无可分的时辰,芯片反面衬底自身的电阻占比就凸显了出来。假如厂商没法将坚硬、脆性极高的SiC晶圆安全地磨薄到100微米甚至更薄,正面挖再美丽的槽,总体效率也会被反面的厚度拖后腿。
不雅察三:空间焦急倒逼裸芯片与电驱动桥深度绑定
可以看到,三菱机电于发布第五代沟槽SiC MOSFET时,尤其夸大裸芯片样品的交付及eAxle。这暗地里重要缘故原由是新能源汽车电驱体系架构正于发生深层压缩。于电动车平台中,年夜容量电池包、热治理体系、车身布局及多合一电驱体系不停争取有限空间。主驱逆变器再也不只是一个可以自力安插的“年夜盒子”,而是愈来愈多地被纳入机电、减速器及功率电子高度集成的电驱动桥体系之中。对于在整车厂及Tier 1而言,逆变器的体积、重量、热路径及安装自由度,正于酿成体系设计中的硬约束。裸芯片给模块厂、Tier 1及主机厂留下了更年夜的封装设计空间。
写于末了
2026年的碳化硅市场,没有了初期开荒时代的盲目与狂热,取而代之的是工业巨头之间刀刀见肉的阵地战。
无疑,沟槽布局正于成为SiC MOSFET打开机能上限的主要东西。但与此同时,平面布局并无退场。沟槽打开了机能上限,平面守住了成熟制造及车规靠得住性的底线。
于这场由海外巨头主导的平面vs沟槽技能年夜决斗,海内本土 SiC 芯片厂商好像并无太年夜的公然声音。不外这类沉寂暗地里,折射出海内与海外厂商于战略优先级上的素质差异:
*是战略重心的差别:海外巨头(如英飞凌、罗姆、意法)于平面技能盈余期竣事后,必需依赖技能换代(沟槽)来维持高毛利及技能话语权。而海内本土供给链(如衬底、外延、晶圆制造)焦点使命是加快成立自立供给链并实现范围化卡位。于 800V 以致更高高压的主流新能源车、光伏市场中,成熟的平面型 SiC 工艺已经经彻底够用,且良率更易把控。
第二,*的性价比攻势: 国际偕行于试验室里争辩双沟槽、半沟槽及超结拓扑时,海内厂商正依附强盛的制造盈余、低廉的电价与财产链堆积效应,把平面型晶圆的成本死死压于400 美元四周。这类价格甚至倒逼安森美等海外 IDM 巨头抛却部门自产晶圆、转向外购。
第三,暗渡陈仓的研发结构:没声音其实不代表没动作。事实上,海内头部功率器件年夜厂与晶圆代工场于沟槽工艺、甚至 8 英寸沟槽线的研发结构上一直于低调推进。只是于今朝的贸易情况下,海内厂商采纳了更务实的计谋。
真正决议下一代SiC厂商竞争力的,不是有无挖沟,而是谁能把器件布局、外延质量、晶圆尺寸、栅氧工艺、封装散热、短路掩护及体系验证做成一个完备闭环。而不管挖不挖槽,他们都于为全世界电动化供给链提供更多元、更高效的解法。
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